VERILOG-HDL 相关硕士博士期刊学术论文

VERILOG-HDL相关论文

基于FPGA的小数分频法的研究与设计

在数字逻辑电路设计中，分频器是一种基本电路。本文提出了一种分频系数为小数的分频器设计的方法，利用Verilog编程，在Xilinx7.1i平台......

会议

数字逻辑电路小数分频法分频器 Verilog-HDL

基于Verilog-HDL描述的多用途步进电机控制芯片的设计

介绍了一种基于 Verilog- HDL描述的多功能步进电机控制芯片的可综合方案 ,该方案可方便地构成两相双极或四相单极步进电机的控制......

期刊

步进电机控制 Verilog-HDL 四相 ispLSI器件可扩展性时钟控制环形分配器模块功能综合方案码效率

Verilog-HDL讲座第六讲用Verilog-HDL做CPLD设计目标板的设计和下载软件的使用

6.1 目标板的制作学习了Verilog—HDL的基本概念,并用其仿真环境Modelsim XE对基本逻辑电路进行仿真后,如果希望在硬件上实现所......

期刊

Verilog-HDL CPLD设计目标板下载软件逻辑电路仿真环境电路功能 Xilinx 配置文件配置设备

Verilog-HDL讲座第八讲用Verilog-HDL做CPLD设计——时序逻辑电路的实现

在第七讲中,已经介绍了组合逻辑电路的实现。组合逻辑电路的特点是:在任意时刻,电路产生的稳定输出仅与当前时刻的输入有关。时序......

期刊

时序逻辑电路 Verilog-HDL CPLD设计组合逻辑电路单脉冲计数模块闪烁灯复位脉冲计数电路时钟同步

基于Verilog-HDL的逻辑分析卡中双向端口的设计

介绍了自行设计逻辑分析卡的系统构成,给出各个功能模块的逻辑框图.然后,从应用的角度简单介绍了ISSI公司的静态RAM芯片IS61LV256,......

期刊

Verilog-HDL 逻辑分析卡 inout 硬件测试法 RAM

基于FPGA和Verilog-HDL的地面数字电视能量扩散模块实现

　　针对能量扩散在数字电视中的作用，本文在地面数字电视标准下，提出了一种基于FPGA(现场可编程门阵列)和Verilog-HDL的能量扩散模......

会议

FPGA开发 Verilog-HDL 地面数字电视能量扩散现场可编程门阵列伪随机二进制序列数字电视标准模块设计方法

一种应用于音频DAC的∑-△调制器的设计

　　提出了一种应用于音频DAC的三阶CRFB结构的∑-△调制器。重点讨论了调制器的设计过程，用MATLAB的Simulink工具箱对该器件的工作......

会议

音频 DAC 调制器 Simulink工具箱硬件描述语言 Verilog-HDL 设计过程工作过程

图像处理DSP的FPGA实现

图像处理技术已广泛应用于通信系统、雷达、生物医学电子学、电子测试设备、工业测试和生活的方方面面.随着计算机技术和人工智能......

学位

数字信号处理器(DSP) 现场可编程逻辑器件(FPGA) 直方图均衡化滤波 Verilog-HDL

16位定点FFT-DSP的FPGA实现

随着计算机技术以及VLSI技术的高速发展,数字信号处理中的核心技术——快速傅立叶变换(FFT)技术应用越来越广,得到了很快的发展,广......

学位

快速傅立叶变换(FFT) 数字信号处理器(DSP) 现场可编程逻辑器件(FPGA) Verilog-HDL

吉比特网络中TCP数据流重组与交付的ASIC设计

随着光纤网络的发展，网络的带宽己达到了吉比特，在今后几年很快就要达到10吉比特甚至数十吉比特。大量事实表明，高速网络中限制终端用......

学位

TCP/IP TCP数据流状态机 Verilog-HDL

利用CPLD实现视频系统的逻辑控制

文章介绍了CPLD技术在数据采集系统中的应用,给出了图形编辑方法实例,展示了CPLD的优势,并对有关CPLD应用的实际问题进行了讨论.......

期刊

CPLD 视频系统图形编辑 Verilog-HDL

同步VLSI设计环境下AES模块的异步流水线结构实现

本文提出了一种可在同步VLSI设计环境下,由已有的流水线结构同步集成电路的算法或者RTL代码直接得到其异步集成电路网表的方法。并......

期刊

异步 VLSI AES 同步流水线 ASIC Verilog-HDL

基于Verilog-HDL的UART串行通讯模块设计及仿真

UART协议是数据通信及控制系统中广泛使用的一种全双工串行数据传输协议,在实际工业生产中有时并不使用UART的全部功能,只需将其核......

期刊

UART 串行通讯 Verilog-HDL Modelsim 仿真

Verilog HDL modeling and design of 10Gb/s SerDes full rate CDR in 65nm CMOS

本文通过对荣华二采区10...

期刊

Verilog-HDL behavioral level model (BLM) phase locked loops(PLL) clock and data

基于ME算法的RS译码器的原理和FPGA实现

RS(Reed-Solomon)码是具有很强纠错能力的线性分组码,广泛应用于各种通信和存储系统中。文中设计的译码器采用修正的欧几里德算法(......

期刊

Reed-Solomon译码 ME算法 FPGA Verilog-HDL

第三讲 Verilog－HDL的基本概念

...

期刊

VERILOG-HDL 与门模块定义门级描述数据流与非门缓冲器或门或非门逻辑仿真

第四讲 Verilog-HDL仿真软件的基本操作

在本讲以Xilinx WebPACK 4.1 ModelSim XE Starter为例,说明仿真软件的基本操作....

期刊

VERILOG-HDL 仿真软件工程文件操作方法

Verilog-HDL讲座——第一讲 Verilog-HDL与CPLD／FPGA设计

1.1从模拟世界到数字世界在二十世纪70年代初期,家用电子产品莫过于晶体管收音机、电唱机、扩音器了,当时的元件市场晶体管分立器......

期刊

VERILOG-HDL CPLD FPGA 数字电路电路设计

基于Verilog—HDL的轴承振动噪声电压峰值检测

介绍模拟峰值电压的检测方式,叙述基于Verilog-HDL与高速A/D转换器相结合所实现的数字式快速轴承噪声检测方法,给出相关的Verilog-......

期刊

VERILOG-HDL 轴承振动噪声电压峰值检测 A/D转换器

MPEG-2视频DCT量化模块FPGA高速实现

提出了一种全硬件实现高速MPEG-2视频DCT量化模块的新方法,并研究了DCT量化算法及其基于FPGA的实现方法.仿真、验证与测试结果均表......

期刊

MPEG-2 离散余弦变换量化硬件描述语言现场可编程门阵列 MPEG-2 DCT quantization Verilog-HDL FPGA

基于FPGA的通用液晶显示控制器的设计和实现

基于FPGA研究了液晶显示的驱动方法,参照液晶显示的逻辑和时序标准设计了可选择分辨率的通用液晶驱动,用Verilog硬件描述语言编写......

期刊

液晶显示 FPGA VERILOG-HDL LCD控制器 liquid crystal display FPGA Verilog-HDL LCD cont

基于FPGA的通用液晶显示控制器的设计和实现

基于FPGA研究了液晶显示的驱动方法,参照液晶显示的逻辑和时序标准设计了可选择分辨率的通用液晶驱动,用Verilog硬件描述语言编写......

期刊

液晶显示 FPGA VERILOG-HDL LCD控制器 liquid crystal display FPGA Verilog-HDL LCD cont

基于FPGA的SPI总线接口设计与实现

文章介绍了SPI总线接1：7原理，对4种工作模式进行了比较，着重分析了SPI总线的工作时序，然后提出了利用Verilog硬件描述语言实现SPI总线......

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SPI总线接口 Veilog硬件描述语言时钟模式 SPI Bus Interface Verilog-HDL Clock Mode

基于Verilog—HDL的逻辑分析卡中双向端口的设计

介绍了自行设计逻辑分析卡的系统构成，给出各个功能模块的逻辑框图。然后，从应用的角度简单介绍了ISSI公司的静态RAM芯片IS61LV256，并......

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Verilog—HDL 逻辑分析卡 inout 硬件测试法 RAM Verilog-HDL logic analysis card inout hardw

扩频通信芯片从RTL到GDSⅡ的设计实现

文章介绍了由我们设计的，并已成功投片的一个扩频通信电路，并简单说明了此电路所采用的设计流程，从RTL到GDSⅡ。......

期刊

扩频通信芯片 RTL GDSⅡ 硬件描述语言寄存器传输级网表直接序列扩频伪随机码序列 Verilog-HDL RTL GDSⅡ Logic Synth

远程抄表系统中抄表电路的FPGA实现

介绍基于FPGA实现远程抄表电路的总体结构、功能,以及模拟和验证结果.Verilog-HDL进行抄表电路各个模块的硬件描述,Xilinx公司ISE......

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FPGA实现远程抄表系统电路 VERILOG-HDL Xilinx公司总体结构硬件描述功能模块 SE软件系统功能控制中心单片机验证模拟

Verilog-HDL讲座第五讲典型基本逻辑路的Verilog-HDL描述

本讲列举几个典型又简单的基本逻辑电路的Verilog-HDL描述。需要说明,仅有本讲的知识还不能具备用Verilog-HDL描述逻辑电路和系统......

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逻辑电路 VERILOG-HDL 数据选择器编码器同步RS触发器

Verilog-HDL讲座第七讲用Verilog-HDL做CPLD设计-组合逻辑电路的实现

首先，来实现一个用两个开关控制一个灯的设计。期望达到的目的如表1所示。...

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VERILOG-HDL CPLD 组合逻辑电路与非门数据选择器二进制编码器

第八讲用Verilog-HDL做CPLD设计—时序逻辑电路的实现

在第七讲中，已经介绍了组合逻辑电路的实现。组合逻辑电路的特点是：在任意时刻，电路产生的稳定输出仅与当前时刻的输入有关。时序逻辑......

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VERILOG-HDL CPLD 电路设计时序逻辑电路闪烁灯可编程单脉冲发生器

第六讲用Verilog－HDL做CPLD设计目标板的设计和下载软件的使用

学习了Verilog-HDL的基本概念，并用其仿真环境Modelsim XE对基本逻辑电路进行仿真后，如果希望在硬件上实现所设计的电路功能，就需要有......

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VERILOG-HDL CPLD 目标板下载软件逻辑电路电路功能

两相时钟方案

选择时钟方案是同步时序集成电路设计的前提.本文阐述了两相时钟方案的规则,通过比较一相时钟与两相时钟方案,给出了两相时钟方案......

期刊

两相时钟同步时序集成电路设计锁存器触发器 VERILOG-HDL two-phase clocking latch flip-flop

基于FPGA设计数字锁相环

为了能在数字通信系统的接收端对信息进行正确译码．需产生一个用作取样判决的位定时脉冲．对采用数字锁相环提取定时脉冲的方法进行分......

期刊

数字锁相环 VERILOG-HDL 位定时脉冲 CMI译码 FPGA DPLL Verilog-HDL bit timing pulse CMI deco

基于FPGA设计数字锁相环

为了能在数字通信系统的接收端对信息进行正确译码．需产生一个用作取样判决的位定时脉冲．对采用数字锁相环提取定时脉冲的方法进行分......

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支持IRDA协议UART的IP核设计

IP核技术是片上系统(SOC)设计的重要技术,已成为目前微电子设计的热点和主要方向.本文根据划分功能模块的层次化设计方法,设计支持......

期刊

UART IP 片上系统红外通信协议 VERILOG-HDL UART IP System-On-a-Chip IRDA Verilog-HDL

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IP核技术是片上系统(SOC)设计的重要技术,已成为目前微电子设计的热点和主要方向.本文根据划分功能模块的层次化设计方法,设计支持......

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UART IP 片上系统红外通信协议 VERILOG-HDL UART IP System-On-a-Chip IRDA Verilog-HDL

基于FPGA的动态目标跟踪系统设计

为了解决基于PC机的视频动态目标跟踪实时性瓶颈问题，设计出一种基于FPGA的动态目标跟踪系统。设计遵循图像处理金字塔模型，针对低层......

期刊

FPGA 视觉跟踪 VERILOG-HDL 动态目标 NIOS II FPGA visual tracking Verilog-HDL moving

基于FPGA的动态目标跟踪系统设计

为了解决基于PC机的视频动态目标跟踪实时性瓶颈问题，设计出一种基于FPGA的动态目标跟踪系统。设计遵循图像处理金字塔模型，针对低层......

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用Verilog—HDL设计数字逻辑系统

介绍硬件描述语言Verilog-HDL。通过与传统的数字逻辑系统的设计方法进行比较，展现了硬件描述语言Verilog-HDL设计数字逻辑电路的优......

期刊

数字逻辑系统 VERILOG-HDL 数字电路设计 Verilog HDL；Hardware description language；EDA；Logic c

改进的并行积分算法低通滤波器的FPGA设计

对积分算法低通滤波器进行了理论分析，通过加Hamming窗对其进行了改进，使其频谱泄漏有了很大改善．分析了并行结构滤波器的实现方法以......

期刊

积分滤波器 VERILOG-HDL FPGA 并行结构 integral filter Verilog-HDL FPGA parallel archite

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对积分算法低通滤波器进行了理论分析，通过加Hamming窗对其进行了改进，使其频谱泄漏有了很大改善．分析了并行结构滤波器的实现方法以......

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积分滤波器 VERILOG-HDL FPGA 并行结构 integral filter Verilog-HDL FPGA parallel archite

可去抖动的时钟脉冲发生器

为了克服晶体振荡器的温漂问题，提高时钟精度，控制输出脉冲。本文设计了一种脉冲发生器，采用基于分频链的时钟校准方法，结合脉冲控制电......

期刊

Verilog-HDL晶体振荡器校准脉冲控制 Verilog-HDL crystal oscillator calibration pulse con

基于时间数字转化技术的温度测量

为了提高温度测量的精度,提出一种应用时间数字转化技术(Time-to-Digital Converter,TDC)测量时间间隔从而测得温度的方法。对RC电......

期刊

时间数字转换技术校准温度测量 VERILOG-HDL TDC Calibrate measured temperature Verilog-HDL

基于时间数字转化技术的温度测量

为了提高温度测量的精度,提出一种应用时间数字转化技术(Time-to-Digital Converter,TDC)测量时间间隔从而测得温度的方法。对RC电......

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时间数字转换技术校准温度测量 VERILOG-HDL TDC Calibrate measured temperature Verilog-HDL

一种基于分频链的时钟校准方法

针对晶体振荡器的温漂特性,设计了一种基于分频链的时钟校准算法。在不改变晶体振荡器的情况下可调节时钟频率,校准精度达±0.......

期刊

VERILOG-HDL 时钟晶体振荡器校准 Verilog-HDL Clock Crystal Oscillator Calibration

通用型SPI总线的IP设计与实现

相对于并行总线,串行总线具有结构简单的优点。近年来人们对系统功能和性能的需求不断地增长,使得处理器需要的外设越来越多。这时......

期刊

SPI总线 VERILOG-HDL FPGA ASIC SPI buses Verilog-HDL FPGA ASIC

一种生成VLAN帧的模块的设计

VLAN（Virtual LocalArea Network）是一种通过将局域网的设备逻辑地而不是物理地划分为一个个网段,从而实现虚拟工作组的新兴技术。不......

期刊

以太网数据帧 VLAN MAC VERILOG-HDL FCS Ethernet frame VLAN MAC Verilog-HDL FCS

Verilog HDL modeling and design of 10Gb/s SerDes full rate CDR in 65nm CMOS

Phase locked loop(PLL) is a typical analog-digital mixed signal circuit and a method of conducting a top level system ve......

期刊

VERILOG-HDL CDR HDL语言 CMOS 设计全速率解串器混合信号电路 Verilog-HDL behavioral level model

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VERILOG-HDL CDR HDL语言 CMOS 设计全速率解串器混合信号电路 Verilog-HDL behavioral level model

基于Verilog—HDL的微机并行数据传送

介绍了微机并行打印口的基本构成,从系统结构、逻辑框图、时序图及打印口控制等多个方面,详细阐述了用并行打印口实现并行数据传送......

期刊

数据传送 VERILOG-HDL 并行打印口 data transmissionVerilogHDL parallel print port

基于FPGA的低功耗微型图像采集系统的设计

为了满足项目应用的需求,设计了一个基于FPGA的低功耗微型图像采集系统。结合CMOS图像探测器的特点,选用Microsemi公司的FPGA作为......

期刊

CMOS图像探测器 FPGA VERILOG-HDL 自上而下 CMOS Image Sensor FPGA Verilog-HDL from Top to B

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